PCIe總線的高吞吐量和低延遲，使得處理器與處理器之間、處理器與外圍芯片之間能更高效地協同工作，這對于處理大規模的神經網絡和復雜的AI模型至關重要， 是AI蓬勃發展的關鍵技術底座之一。

根據行業動態推測，新一代PCIe規范 - PCIe Gen6將在2025年下半年開始加速落地。 值此技術迭代的關鍵時期，泰克(Tektronix)和安立(Anritsu)在2025年8月26日于蘇州舉辦的PCIe技術發展大會上，展出了物理層發送端&接收端一致性測試的完整解決方案，并對瀾起的PCIe6 Retimer產品在現場進行了實測演示。優異的實測結果展示了泰克、安立和瀾起領先的產品力。

PCIe：AI算力的關鍵底座

隨著人工智能與大模型的爆發式增長，數據中心與高性能計算系統對高速互連的依賴日益增強。PCIe總線憑借高吞吐量、低延遲、良好的兼容性，成為處理器與處理器、處理器與加速器、處理器與存儲/網絡之間協同的核心通道。

-在AI訓練 場景中，PCIe 提供海量數據搬運能力，確保 GPU/AI 加速器高效并行。

-在數據中心與云計算 中，PCIe 保證高速網絡卡、存儲設備與 CPU 的高效交互。

-在車規與邊緣計算 領域，PCIe 則是實時處理與低功耗優化的基礎設施。

隨著速率跨越式提升至 64 GT/s (Gen6)，鏈路中的損耗、抖動、誤碼等問題更加突出，一致性驗證和信號完整性保障成為產業升級的關鍵。根據行業預測，PCIe Gen6 將在2025年下半年開始加速落地，這也意味著整個生態對測試與驗證工具提出了前所未有的要求。

技術迭代下的合作展示

在這一關鍵時期，泰克 (Tektronix) 與安立 (Anritsu) 于2025年8月26日在蘇州舉辦的 PCIe 技術發展大會上，聯合展出了 物理層發送端與接收端一致性測試的完整解決方案，并攜手瀾起科技 (Montage) 現場實測了其 PCIe Gen6 Retimer 產品。

本次演示不僅覆蓋了 CEM一致性測試的完整流程，還通過真實 DUT 的接入，向業界展示了可落地、可追溯的測試能力。

發送端一致性測試：精細化控制與自動化分析

在發送端 CEM 測試環節，泰克 59GHz 示波器作為核心儀器，承擔了高精度波形采集與自動化分析任務。

-碼型切換與損耗仿真：示波器聯動AFG 自動切換測試碼型，并在 Gen6 測試模式下注入 18.2 dB 鏈路損耗，真實還原高速互連環境。

-參數測量覆蓋全面：包括眼圖（眼高/眼寬）、抖動（Jitter）、SNDR（信噪失真比）、Preset 測試等，全面對標PCI-SIG 協會規范。

-噪聲修正：通過內置工具建立Scope Noise 數據庫，消除示波器底噪影響，確保結果的準確性。

-自動化分析：結合PAMJET 軟件，完成長時間波形的自動采集與結果判定，生成 Pass/Fail 報告。

現場結果表明：

-眼高、眼寬裕量充足，遠高于協會最低要求；

-眼圖對稱性良好，信號完整性表現穩定；

-測試流程全自動化，工程師無需手動反復調試，大幅提升效率。

接收端一致性測試：鏈路訓練與誤碼驗證

在接收端測試環節，安立 MP1900A BERT 配合瀾起 DUT，完成了基于 PCIe Gen6 最新規范的 Link Training 與誤碼率驗證。

-測試拓撲：PG 輸出→ ISI 通道 → CBB  → DUT 接收端 → DUT 發射端環回輸出 → BERT 內置 Redriver & Equalizer → 誤碼檢測。

-校準過程：首先完成接收端校準，選擇合適的ISI Pair，確保鏈路處于標準損耗環境下。

-BER 測試：在完整訓練至64 GT/s 鏈路下，DUT 的 First BER 達到 1E-10，完全滿足 CEM 規范。

-調試功能：系統可追蹤從Gen1 (2.5 GT/s) 到 Gen6 (64 GT/s) 的完整訓練過程，便于工程師快速定位鏈路問題。

共贏未來：測試為創新護航

通過本次聯合演示，業界可以看到 PCIe Gen6 從規范到實測落地的可行性：

-加速AI 算力規模化：為大模型訓練與推理提供穩定的高速互連。

-支撐新一代數據中心：幫助服務器、網絡與存儲系統實現更高能效比。

-推動本土創新：瀾起Retimer 的成功驗證，標志著本土芯片企業在 PCIe Gen6 生態中的重要地位。

此次泰克與安立的合作展示，不僅展現了全流程一致性驗證能力，也通過與瀾起的協作，體現了測試廠商與本土企業共建生態的決心。未來，泰克將繼續秉持 “測試為先” 的理念，攜手更多合作伙伴推動 PCIe Gen6 的產業化落地，為 AI、數據中心、新能源與高性能計算等前沿應用提供堅實的互連基礎。

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